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Logisim单周期CPU Logisim单周期CPU 已通过仿真测试 可以运行小规模程序
Logisim单周期CPU Logisim单周期CPU 已通过仿真测试 可以运行小规模程序
2019-12-21 20:49:32
17KB
CPU
1
基于安卓开发的备忘录学年设计文档(已通过老师审核)
基于安卓开发的备忘录学年设计文档,且已经通过老师的审核
2019-12-21 20:48:36
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php websocket聊天实例,已通过调试测试
php websocket聊天实例,即时发送消息,即时接收消息;已通过调试运行能用
2019-12-21 20:30:18
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一个简单双核CPU的verilog实现(加中断、异常处理,已通过实验箱验证)
一个简单双核CPU的verilog实现(加中断、异常处理已通过实验箱验证)可以实现双核交替访存,提高访问存储器效率,同时可以通过内存数据区实现双核数据的共享。
2019-12-21 20:10:43
30KB
双核
verilog
CPU
实验箱
1
Random Walks 标准程序,MATLAB程序,调试已通过,直接可用
Random Walker 标准程序,MATLAB程序,调试已通过,直接可用
2019-12-21 19:29:46
6.5MB
RandomWalks
,MATLAB
1
EDA实验模可变计数器 设计程序,已通过
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2019-12-21 19:26:46
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EDA实验
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设计程序
已通过
1
二维小波去噪MATLAB程序(已通过仿真)
本程序是自己编写的,对含噪信号采用二维小波去噪程序,能很好的去除噪声,得到有用信号。
2019-12-21 18:57:36
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小波,去噪
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