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基于Quartus II的数字系统Verilog HDL设计实例详解
基于Quartus II的数字系统Verilog HDL设计实例详解 很经典的书籍!高清!
2021-07-13 14:26:18
39.86MB
Quartus
II
Verilog
HDL
1
基于quartusii的8位乘法器
基于quartusII的8位乘法器,采用VHDL语言
2021-07-07 19:08:31
631KB
EDA
8位乘法器
1
eda 8位10进制频率计数器课程设计 基于quartus II
eda 8位10进制频率计数器课程设计 基于quartus II 基于quartus II 的八位10进制计数器,共一个顶层文件和两个底层文件,有图形设计法和代码设计法,解压后直接打开工程文件即可。
2021-07-04 11:02:28
704KB
十进制计数器
基于Quartus II13.0sp1的网络芯片W5100的FPGA驱动程序
FPGA为Altera的Stratix_II系列 的EP2S180F1020I4,开发平台为Quartus II13.0sp1,实现了UDP的收发功能,代码中涉及到了fifo的使用,希望对大家有所帮助
2021-07-01 14:51:55
6.84MB
Altera
FPGA
1
基于Quartus II的交通灯控制电路设计.ppt
EDA软件Quartus II的基本 操作方法。熟悉MSI组合逻辑电路和时序逻辑路的逻辑功能及使用方法 。掌握MSI组合逻辑器件和时序逻辑器件组成数字小系统的设计和测试方法。学会使用Quartus II设计、仿真和调试数字逻辑电路
2021-07-01 13:43:07
928KB
EDA软件Quartus
II的
MSI组合逻辑电路和时序逻辑路
代码实现
1
基于QuartusII的多功能数字钟设计
基于QuartusII的多功能数字钟设计,很好
2021-06-27 20:10:39
883KB
基于QuartusII的多功能数字钟设计
1
基于Quartus II免费IP核的双端口RAM设计实例.rar
quartus ii的双端口RAM实现。双口RAM分伪双口RAM(Xilinx称为Simple two-dual RAM)与双口RAM(Xilinx称为true two-dual RAM),伪双口RAM,一个端口只读,另一个端口只写,且写入和读取的时钟可以不同,位宽比可以不是1:1;而双口RAM两个端口都分别带有读写端口,可以在没有干扰的情况下进行读写,彼此互不干扰0;
2021-06-27 19:08:30
992KB
RAM
1
基于quartus的m序列产生
fpga m序列产生
2021-06-26 09:52:35
4KB
fpga
m序列
1
基于QuartusII的出租车计费系统.docx
基于QuartusII的出租车计费系统
2021-06-25 09:02:22
523KB
基于QuartusII的出租车计
基于QuartusII17的Nios软核设计
基于Quartus17版本的软核设计流程,简单的Hello_world程序,给初学者交流。
2021-06-23 09:29:47
2.64MB
Nios
quartus17
1
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