在发现希格斯玻色子后，提出了一些未来的实验来研究希格斯玻色子的性质，包括两个圆形轻子对撞机CEPC和FCC-ee，以及一个线性轻子对撞机ILC。 我们在测量带电的轻子风味违反希格斯衰变的分支比率时评估了这些对撞机的精确范围$ H \ rightarrow e ^ \ pm \ mu ^ \ mp $$ H→e±μ∓，$$ e ^ \ pm \ tau ^ \ mp $$ e±τ∓和$$ \ mu ^ \ pm \ tau ^ \ mp $$μ±τ∓。 圆形（线性）对撞机给出的分支比率的预期上限为$$ {\ mathcal {B}}（H \ rightarrow e ^ \ pm \ mu ^ \ mp）<1.2〜（2.1）\ 乘以10 ^ {-5} $$ B（H→e±μ∓）<1.2（2.1）×10-5，$$ {\数学{B}}（H \ rightarrow e ^ \ pm \ tau ^ \ mp ）<1.6〜（2.4）\乘以10 ^ {-4} $$ B（H→e±τ∓）<1.6（2.4）×10-4和$$ {\ mathcal {B}}（H \ rightarrow \ mu ^

在左-右孪生希格斯（LRTH）模型的框架中，我们考虑了最近一次在LHC上寻找高质子核共振的约束，并发现重中性玻色子ZH的质量低于2.76 TeV。 在这些约束下，我们研究了希格斯-格格勒耦合生产过程e + e-→ZH，e + e-→νeνe¯H和e + e-→e + e-H，上夸克汤河耦合生产过程e + e- →tt¯H，在e + e-对撞机上，希格斯自耦产生过程e + e-→ZHH和e + e-→νeνe¯HH。 此外，我们研究了希格斯玻色子的主要衰变模式，即h→ff′（f = b，c，τ），VV⁎（V = W，Z），gg，γγ。 我们发现LRTH效应相当大，因此e + e-对撞机上的希格斯玻色子过程可能是LRTH模型的敏感探针。

质子衰变是大统一理论（GUT）最重要的预测之一。 在超对称（SUSY）GUT中，需要抑制通过五维算子进行的质子衰减。 在SO（10）模型中，其中10 + 126‾的希格斯场耦合到费米子，中微子振荡参数（包括CP违规的Pontecorvo–Maki–Nakagawa–Sakata（PMNS）相）可以与Yukawa耦合相关，以生成尺寸5 统一框架中的运营商。 我们展示了抑制的质子衰减如何取决于PMNS相，并强调了PMNS相以及中微子23混合角的精确测量的重要性。 如果在不久的将来在大型强子对撞机中发现SUSY粒子少于大约TeV，并且在不久的将来在Hyper-Kamiokande和DUNE实验中观察到质子衰减，这些将变得尤为重要。

“后sphaleron重生成”是一种新的，深刻的重生成机制，它解释了帕蒂·萨拉姆对称性框架下我们当前宇宙的反物质不对称性。 我们在这里尝试通过恢复一条新颖的对称断裂链并将这种机制嵌入非SUY SO（10）统一理论中，该断裂链以Pati'Salam对称为中间对称断裂步骤，并解决了phapharon的重生和中子现象。 ”以合理的方式反中子振荡。 在我们的模型中，在105到106 GeV和中子的混合时间下，实现了基于规范组SU（2）L？SU（2）R？SU（4）C的Pati Salam对称性。 具有模型参数的反中子振荡过程具有B = 2被发现是“ n-n” 108 – 1010 s，这是在即将进行的实验范围内。 该模型的其他新颖特征包括低尺度右手WR±，ZR规范玻色子，通过经规范的反向（或扩展）跷跷板机制对中微子振荡数据的解释，以及最重要的是TeV尺度彩色六重标量粒子负责可观察到的n？ LHC可能可以访问的n振荡。 我们还将考虑在有色和无色六面体标量的情况下，规范耦合的统一性和质子寿命的估计。

该文件包含两份由74LS190设计的10以内与100以内的十进制加减计数器，通过四引脚数码管显示加减计数，电路由multisim.14软件仿真设计，内包含74LS190功能表图片与电路图片，电路设计详情可见主页博文。

使用STM32产生精准脉冲个数，通过步进电机驱动器驱动电机运行，支持S曲线加减速。

一级圆柱齿轮减速器装配图及cad图纸，仅供参考

任意长的整数加减法运算 设计算法，实现一个任意长的整数进行加法、减法运算的演示程序。例如：1234，5123，4512，3451，2345与-1111，1111，1111，1111，1111的加法结果为：0123，4012，3401，2340，1234。基本要求如下： （1） 利用链表实现长整数的存储，每个节点含一个整型变量； （2） 整型变量的范围：-（2^15 -1）~（2^15 -1）； （3） 输入与输出形式每四位一组，组间用逗号分隔开。如：1986,8213,1935,2736,3299； （4） 界面友好，每步给出适当的操作提示，并且系统具有一定的容错能力。 至少给出下面的测试数据： （1）0； 0 （2）-2345,6789； -7654,3211 （3）-9999,9999； 1,0000,0000,0000 （4）1,0001,0001； -1,0001,0001 （5）1,0001,0001； -1,0001,0000 （6）-9999,9999,9999； -9999,9999,9999 （7）1,0000,9999,9999； 1

1.1.1 ALU（算数逻辑单元）是CPU的基本组成部分。掌握定点数加减法溢出检测方法。理解算术逻辑运算单元ALU的基本构成。熟悉Logisim中各种运算组件，有逻辑运算部件和算术运算部件。熟悉多路选择器的使用，通过对ALU的工作原理和逻辑功能的理解，设计16位简单ALU。 1.1.2 功能要求 ALU需要实现对应的加减、逻辑运算、移位、比较等功能并采用仿真软件设计和对软件进行调试。 1.2 总体设计 1.2.1 总体设计原理 ALU是一种功能较强的组合逻辑电路，它能进行多种算术运算和逻辑运算。ALU给出运算结果的同时，还给出结果的某些特征，如溢出否，有无进位输出，结果是否为零、为负等，这些结果特征信息通常被保存在几个特定的触发器中。在执行指令的过程中，必须向ALU提供其执行何种运算的控制信号。

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